EF-ISE-DSP-FL【PDF 77/83 页】SOFTWARE ISE DSP EDITION

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Additional Examples and Tutorials

Topic

Importing a Verilog

Importing a Xilinx

ChipScope Examples

Topic

Using ChipScope Pro

Analyzer for Real-

DSP Examples

Topic

DSP48 Macro Block

(35-Bit Multiplier

using DSP48 and

Constant block)

DSP48 Macro Block

(FIR filter using the

DSP48 Macro block as

a multiply accumulate

function)

FIR filter examples

using DSP48 block

(DSP48-based

dynamic shifter)

Description

A tutorial showing how to use the black box to import Verilog into

a System Generator design and how to use ModelSim to co-simulate

the Verilog module.

A tutorial showing how to import a COREGEN module as a black

box.

Description

This tutorial demonstrates how to connect and use the Xilinx Debug

Tool called ChipScope ? Pro within Xilinx System Generator for

DSP. The integration of ChipScope Pro in the System Generator flow

allows real-time debugging at system speed.

Description

Simple example demonstrating the use of the DSP48 block with the

Constant block used to provide the DSP48 instruction.

Simple example demonstrating how to use a DSP48 Macro block to

implement a Complex Multiplier.

This design demonstrates the use of the DSP48 and Constant block

in implementing 35 by 35-bit multipliers at different sample rates.

Three multipliers implementations are shown at 1, 2, and 4 clocks

per sample.

This design demonstrates the use of the DSP48 Macro block in

implementing a 35 by 35 Multiplier.

This design demonstrates the use of the DSP48 and Constant block

in FIR filter implementation. The design includes sets of parallel,

semi-parallel and sequential FIR filter using Type 1 and Type 2

architectures. Each filter implements a 16-tap dsp48-based FIR

filters.

This design demonstrates the use of the DSP48 block in

implementing a 35-bit signed right shift using 2 DSP48s.

System Generator for DSP Getting Started Guide

UG639 (v 13.1) March 1, 2011

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